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Xilinx Versal ACAP - From FPGA to Platform - WEBINAR

With the Versal ACAP Family Xilinx introduces a completely new architecture that allows to efficiently deploy a wide range of heterogenous computation resource. 
This Webinar describes the core concepts of the device family and introduces the computation engines, the APU (Arm A72) and the RPUs. As evolution to the MPSoC, the Versal family exhibits a hardened platform that allows to bind further acceleration engines to these CPUs with predictable performance. The architecture knowledge is used to generate a platform in Vivado and a short outlook into the acceleration kernel design with Vitis is given.

 

Registrierung:

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Termin:

Falls Ihnen der Termin nicht zusagt haben Sie weiterhin die Möglichkeit dieses Webinar anzusehen. Das Webinar wird aufgenommen und ist danach "on demand" verfügbar. 

Live:

Sie haben während des Webinars Zeit direkt Fragen an den Trainer zu stellen.

Sprache:

Die Kurssprache ist englisch.


Anwendbare Technologien

  • XILINX Versal ACAP
  • XILINX FPGAs

Voraussetzungen

  • Keine

Termine


29.01.2021 | Online
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Dauer und Kosten


Dauer: 1 Stunde

Kosten: 0,00 €
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Ansprechpartner


Michael Schwarz

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