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Versal ACAP: The processing system interfaces - WEBINAR

With the Versal ACAP familiy many elements are an evolution from the Zynq Ultrascale+ MPSoC devices. This session will cover the SoC features to provide insight into the full width of peripherals and connectivity in the processing system (or now CIPS) of these devices offer. Furthermore, the interconnects to other regions of the devices are described to give insight into the capabilities of the ACAP technology and hint on variability of systems built on these.

 

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Sprache:

Die Kurssprache ist englisch.


Anwendbare Technologien

  • Acceleration and AI
  • XILINX FPGAs
  • XILINX Versal ACAP

Voraussetzungen

  • Keine

Termine


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Dauer und Kosten


Dauer: 1 Stunde

Kosten: 0,00 €
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Ansprechpartner


Michael Schwarz