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DDR4 Interfacing with XILINX FPGAs

Stuttgart / Berlin / Frankfurt / Stuttgart

Die neuen Xilinx UltraScale Familien gestatten sehr schnelle Interfaces zu externen Speichern. Dabei kommen weiterentwickelte Strukturen auf den Devices und ein neuer Wizard zum Generieren der Controller zum Einsatz. Mit den neuen UltraScale Familien verlagern sich verstärkt Realisierungsherausforderungen vom Chiplevel hin zum Boardlevel. Die sehr hohen Datenraten erfordern extreme Sorgfalt im PCB-Design.
Der 3-tägige Workshop “DDR4 Interfacing with Xilinx FPGAs“ richtet sich sowohl an Hardwaredesigner als auch an Systemarchitekten und Layoutdesigner, die DDR4 Interfaces erfolgreich im System einsetzen wollen. Mit diesem Workshop wird der Entwickler in die Lage versetzt, die verfügbaren Optionen der IOBs und Taktressourcen effektiv einzusetzen. Dabei stehen auch die Belange der Signalintegrität im Vordergrund. Es werden sowohl die Parameter der Signalqualität als auch das Timing eingehend behandelt. Anhand eines Boards mit DDR4 Memories werden praktische Design- und Verifikationsbeispiele erläutert. Die PCB-Level Simulationsoptionen werden ausführlich vorgestellt und mittels Übungen demonstriert. Im Kurs werden Richtlinien für eine erfolgreiche Realisierung von schnellen Memory-Interfaces erarbeitet. Methodische Hinweise zur erfolgreichen DDR4 Realisierung runden den Workshop ab.


Anwendbare Technologien

UltraScale FPGAs

MPSoC Familien


Voraussetzungen

Grundlegende Kenntnisse über VHDL

Grundlegende Kenntnisse über FPGA-Implementierung

Termine


09.12.2019 in Stuttgart
17.02.2020 in Berlin
01.07.2020 in Frankfurt
01.12.2020 in Stuttgart

Dauer und Kosten


Dauer in Tagen: 3Kosten: € 2.100,00 (netto pro Teilnehmer inkl. ausführlichen Schulungsunterlagen sowie Pausengetränken und Mittagessen)

Ansprechpartner


Michael Schwarz

Michael Schwarz

+49 (0) 7664 91313-15
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