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RISC-V Core Verification and Compliance Testing

Dieser Kurs wurde entwickelt, um die RISC-V-Architektur, ihre Implementierung in FPGA sowie Methoden und Tools zur Überprüfung und Validierung anhand der Konformitätstestspezifikation zu veranschaulichen. Für die Validierung der RISC-V System Implementierung im FPGA wird auch eine Übersicht von Methoden und Design-Rule-Checks in Vivado vermittelt. Die RISC-V-Computerarchitektur wird aufgezeigt, um auch anschließend ein spezifi sches embedded System mit dem Core zu realisieren und die Implementierung dieser Befehlssätzen sicherzustellen. Der Überblick über die Grundbausteine der RISC-V-Hardware mit Erläuterung von Methoden und Werkzeuge ermöglicht umfassende Überprüfungen von Funktionalität in Simulation und Hardware Ausführung. Auch die arithmetische ALU Unterstützung wie Festkommaund Fließkommaverarbeitung wird mit veranschaulicht. Der Prozess des Aufbaus einer Verifi zierungsumgebung unter Verwendung verschiedener Ansätze wird gezeigt. Der Kurs beinhaltet die Implementierung mit einem RV32/ RV64 compliant RISC-V CPU-Kern.
Die Entwicklung der Soft ware wird dargestellt, um das eingebettete System auf der Xilinx FPGA-Plattform zu realisieren. In der zu definierenden Testumgebung muss die Funktionalität des erstellten embedded Projektes simuliert werden können. Behandelt werden Methoden der FPGA Implementierungs- Analyse um Aussagen von Ressourcen, Echtzeitfähigkeit und Zuverlässigkeit sicherzustellen. Der Kurs vermittelt sowohl theoretische als auch praktische Inhalte.


Anwendbare Technologien

  • XILINX FPGAs

Voraussetzungen

  • Kenntnisse im Programmieren mit C/C++
  • Grundkenntnisse des XILINX FPGA Design Flows
  • Grundkenntnisse von Linux Shell Scripting

Termine


29.03.2021 | Frankfurt
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01.06.2021 | München
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06.09.2021 | Berlin
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13.12.2021 | Stuttgart
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Dauer und Kosten


Dauer: 2 Tage

Kosten: 1.500,00 €
netto pro Teilnehmer inklusive ausführlicher Schulungsunterlagen sowie Pausengetränke und Mittagessen

Ansprechpartner


Michael Schwarz

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