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VIVADO XDC and STA

Die Vivado™ Design Suite ist eine neue Entwicklungsumgebung.Besondere Funktionen machen sie ideal für Designs, welche auf IPs basieren oder komplette Systeme integrieren. Bei der Vivado™ Design Suite handelt es sich um eine stark integrierte Entwicklungsumgebung, die auf einer systemorientierten Generation von Werkzeugen basiert. Das Rückgrat hierfür bilden eine übergreifende, skalierbare Datenbasis und eine einheitliche Testumgebung. Neben anderen Neuerungen, wurden in Vivado die bisher verwendeten UCF- durch die neuen XDC-Constraints ersetzt. Die Vivado Design Suite verwendet einen für Xilinx neuen Ansatz zur Spezifikation der Timinganforderungen an ein Design. Die bei der ISE Entwicklungsumgebung verwendeten Konstrukte zur Timingspezifikation (UCF) sind nicht mehr gültig und werden durch XDC-Befehle (XILINX Design Constraints) ersetzt. Dieses Seminar wendet sich an Teilnehmer ohne spezielle Vorkenntnisse im Bereich der XILINX Timing Constraints. Dabei kommt die Erstellung der Constraints genauso zur Sprache wir die Timinganalyse. Tipps und Hinweise zur allgemeinen Vorgehensweise ergänzen die Ausführungen.


Anwendbare Technologien

7-Series Families oder neuere

Anforderungen

Grundkenntnisse der FPGA-Technologie sind hilfreich
Grundkenntnisse von Vivado sind hilfreich
Grundkenntnisse VHDL

Termine

26.04.2017 in München
29.06.2017 in Stuttgart
14.09.2017 in Berlin
16.11.2017 in Hamburg

Dauer und Kosten

Dauer in Tagen: 1
Kosten: kostenfrei
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